El diseño de chips de IA está llevando el empaquetado de chips progresista al confín: existen soluciones para los límites del empaquetado 2.5D, pero faltan abriles para que sean viables.

Hojas de ruta premium de Tom’s Hardware

un fragmento del artículo sobre la hoja de ruta de HBM

(Crédito de la imagen: futuro)

A medida que los aceleradores de IA y los dispositivos HPC crecen y se vuelven más complejos, el diseño de chips progresista continúa alejándose del transistor y acercándose al paquete. Durante el año pasado, los ingenieros de embalaje y las fundiciones convergieron en la misma conclusión: que la integración 2.5D es ahora la principal tecnología responsable de la entrega de energía, la integridad de la señal en anchos de lado extremos, la estabilidad mecánica en grandes áreas y, en algunos casos, incluso la funcionalidad activa.

Esto es evidente en toda la industria, desde los intercaladores de silicio más gruesos diseñados para soportar HBM4, hasta el renovado interés en los puentes de silicio y el interés a liberal plazo en las alternativas orgánicas y de vidrio. La tecnología en sí no es nueva, pero enfrenta limitaciones completamente nuevas a medida que la IA ha empujado los envases 2.5D a un división donde sus supuestos originales de costo y rendimiento ya no se cumplen, y la próximo escalón consiste en animarse qué problemas vale la pena resolver con silicio y cuáles no.

Los intercaladores se están convirtiendo en plataformas de poder

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